Analysis of 6T Full Adder using 2T XOR and 2T XNOR Module
Author:
Affiliation:
1. Easwari Engineering College,Electronics and Communication Engineering,Chennai,India
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10134573/10134574/10134726.pdf?arnumber=10134726
Reference15 articles.
1. A 14-transistor CMOS full adder with full voltage-swing nodes
2. New low-voltage circuits for XOR and XNOR;lee;Proc IEEE Southeastcon,1997
3. An area-efficient static CMOS carry-select adder based on a compact carry look-ahead unit
4. Modified Binary Multiplier Architecture to Achieve Reduced Latency and Hardware Utilization
5. The novel efficient design of XOR/XNOR function for adder applications
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