A Jitter-Tolerant Referenceless Digital-CDR for Cellular Transceivers
Author:
Funder
Samsung Electronics
IITP
IC Design Education Center (IDEC)
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/9336024/9336095/09336143.pdf?arnumber=9336143
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1. 1.4-8 Gb/s Low Power Quarter-Rate Single-Loop Referenceless CDR With Unlimited Capture Range;IEEE Transactions on Circuits and Systems II: Express Briefs;2024-09
2. A Low-Cost 0.00063-mm2, 0.44-pJ/b, 2-Gb/s All-Digital Fully Synthesizable CDR for Serial Links Using Single-Phase Input Clock;IEEE Transactions on Circuits and Systems II: Express Briefs;2022-10
3. A Referenceless Digital CDR with a Half-Rate Jitter-Tolerant FD and a Multi-Bit Decimator;Electronics;2022-02-11
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