Direct optimization of a PCI express link equalization in industrial post-silicon validation
Author:
Publisher
IEEE
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http://xplorestaging.ieee.org/ielx7/8340944/8347228/08347238.pdf?arnumber=8347238
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1. PCIe Gen6 Physical Layer Equalization Tuning by Using Unsupervised and Supervised Machine Learning Techniques;2023 IEEE MTT-S Latin America Microwave Conference (LAMC);2023-12-06
2. A Multi-Stage CTLE Design and Optimization for PCI Express Gen6.0 Link Equalization;2023 IEEE Latin American Electron Devices Conference (LAEDC);2023-07-03
3. PCIe Gen5 Physical Layer Equalization Tuning by Using K-Means Clustering and Gaussian Process Regression Modeling in Industrial Post-Silicon Validation;2023 IEEE MTT-S International Conference on Numerical Electromagnetic and Multiphysics Modeling and Optimization (NEMO);2023-06-28
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