A Formal Based Verification Methodology for DFD Mux-Tree Hierarchies
Author:
Affiliation:
1. Intel Technologies Private Limited,Client Computing Group-AI (CCGAI),Bangalore,India
2. Intel Technologies Private Limited,Data center-AI (DCAI),Bangalore,India
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx8/10649891/10651626/10651913.pdf?arnumber=10651913
Reference10 articles.
1. Modeling and Characterization of VBUS Power Discharge for Embedded Superspeed USB Host/Devices
2. On efficient silicon debug with flexible trace interconnection fabric
3. Implications of On-Chip Single-Source Clocking on High-Speed Serial Interfaces in Network SoC
4. A Formal Approach to Improve Connectivity Coverage in DFD, DFT, DFM, and DFX Domain
5. Top Level SOC Interconnectivity Verification Using Formal Techniques
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