Design and analysis of high performance 9 bit SAR ADC with SFDR 76.59
Author:
Publisher
AIP Publishing
Link
http://aip.scitation.org/doi/pdf/10.1063/5.0082115
Reference28 articles.
1. Comparative Analysis of CMOS ADC Topologies with Different Performance Parameters
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3. Analysis of IC op-amp power-supply current sensing
4. A 12 bit 1 GS/s Dual-Rate Hybrid DAC With an 8 GS/s Unrolled Pipeline Delta-Sigma Modulator Achieving > 75 dB SFDR Over the Nyquist Band
5. A 12-bit 40 nm DAC Achieving SFDR > 70 dB at 1.6 GS/s and IMD < –61dB at 2.8 GS/s With DEMDRZ Technique
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