A 3.84 gbits/s AES crypto coprocessor with modes of operation in a 0.18-μm CMOS technology

Author:

Hodjat Alireza,Hwang David D.,Lai Bocheng,Tiri Kris,Verbauwhede Ingrid

Publisher

ACM Press

Cited by 16 articles. 订阅此论文施引文献 订阅此论文施引文献,注册后可以免费订阅5篇论文的施引文献,订阅后可以查看论文全部施引文献

1. Securing AES Designs Against Power Analysis Attacks: A Survey;IEEE Internet of Things Journal;2023-08-15

2. A 3.65 Gb/s Area-Efficiency ChaCha20 Cryptocore;2022 19th International SoC Design Conference (ISOCC);2022-10-19

3. High Throughput Folded Architecture of AES;2021 5th Conference on Information and Communication Technology (CICT);2021-12-10

4. RFTC;Proceedings of the 56th Annual Design Automation Conference 2019;2019-06-02

5. Asynchronous hardware implementations for crypto primitives;Microprocessors and Microsystems;2019-02

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