Current-integrating summer for DFE receiver with low common mode variation

Author:

Kondeti Poorna ChandrikaORCID,Prusty Suraj KumarORCID,Wary NijwmORCID

Publisher

Elsevier BV

Subject

General Engineering

Reference20 articles.

1. I/O design at 25Gb/s and beyond: Enabling the future communication infrastructure for big data;Chang,2015

2. A tunable, power efficient active inductor-based 20 Gb/s CTLE in SerDes for 5G applications;Thulasiraman;Microelectron. J.,2020

3. A 20-Gb/s charge-steering equalizer utilizing highly-efficient charge-steering linear equalizer;Saif;Microelectron. J.,2021

4. A 32 Gb/s PAM-16 TX and ADC-based RX AFE with 2-tap embedded analog FFE in 28 nm FDSOI;Celik;Microelectron. J.,2021

5. A 56-Gb/s PAM4 receiver analog front-end with fixed peaking frequency and bandwidth in 40-nm CMOS;Li;IEEE Trans. Circuits Syst. II,2021

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