Design and Simulation of Balanced Ternary Priority Encoder

Author:

Goenka Aadarsh GaneshORCID,Mitra ShyamaliORCID,Maheshwari Harsh,Das Nibaran

Publisher

Elsevier BV

Reference18 articles.

1. Cramming more components onto integrated circuits;Moore;Electron. Mag.,1965

2. A logic synthesis methodology for low-power ternary logic circuits;Kim;IEEE Trans. Circuits Syst. I. Regul. Pap.,2020

3. CNTFET-based design of ternary arithmetic modules;Sharma;Circuits Systems Signal Process.,2019

4. Implementation and applications of a ternary threshold logic gate;Unutulmaz;Circuits Systems Signal Process.,2023

5. P. Beckett, Towards a balanced ternary FPGA, in: 2009 International Conference on Field-Programmable Technology, 2009, pp. 46–53.

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