Testing of Weak Open Defects in Interconnects Using Boundary Scan
Author:
Affiliation:
1. Tokushima University
2. Tokushima Study Center, The Open University of Japan
Publisher
Japan Institute of Electronics Packaging
Link
https://www.jstage.jst.go.jp/article/jiep/27/4/27_288/_pdf
Reference10 articles.
1. 1) ケンパーカー(著),亀山修一(監訳):“バウンダリスキャンハンドブック第3版,”青山社,2012
2. 2) 亀山修一,馬場雅之,樋上喜信,高橋 寛:“アナログバウンダリスキャンによる三次元積層後のTSV抵抗精密計測法,”電子情報通信学会論文誌 D,Vol. J97-D, No. 4, pp. 887–890, 2014
3. 3) 橋爪正樹,伊喜利勇貴,小西朝陽,四柳浩之,S.-K. Lu:“バウンダリスキャンテスト機構を用いたはんだ接合部の電気検査法とその組込型検査回路,”エレクトロニクス実装学会誌,Vol. 19, No. 3, pp. 161–165, 2016
4. 4) 曽根田伴奈,神田道也,四柳浩之,橋爪正樹,S.-K. Lu:“電気試験法による実装基板内抵抗断線の出荷後検出法,”第29回マイクロエレクトロニクスシンポジウム,pp. 131–134, 2019
5. 5) Y. Ikiri, et al.: "Open Defect Detection in Assembled Circuit Boards With Built-In Relaxation Oscillators," IEEE Trans. Components, Packaging and Manufacturing Technology, Vol. 11, No. 6, pp. 931–943, Jun. 2021
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