A 105-dB SFDR 16-bit SAR ADC with a Window Capacitor Calibration Scheme
Author:
Affiliation:
1. National Taiwan University of Science and Technology,Department of Electronic and Computer Engineering,Taipei City,Taiwan
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx8/10557746/10557828/10558376.pdf?arnumber=10558376
Reference8 articles.
1. A 1V 11fJ/conversion-step 10bit 10MS/s asynchronous SAR ADC in 0.18µm CMOS
2. A 12-bit 8.47-fJ/Conversion-Step Capacitor-Swapping SAR ADC in 110-nm CMOS
3. A 16-Bit Calibration-Free SAR ADC With Binary-Window and Capacitor-Swapping DAC Switching Schemes
4. A 12-bit 104 MS/s SAR ADC in 28 nm CMOS digitally-assisted wireless transmitters;Tseng;A-SSCC,2015
5. A 16-bit 16MS/s SAR ADC with on-chip calibration in 55nm CMOS
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