1.55mW 2GHz ERBW 7b 800MS/s 3-stage Pipelined SAR ADC in 28nm CMOS using a Kickback-Cancelling 7T-Dynamic Residue Amplifier with only 16fF Input Capacitance-Reference-Cited by-同舟云学术

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1.55mW 2GHz ERBW 7b 800MS/s 3-stage Pipelined SAR ADC in 28nm CMOS using a Kickback-Cancelling 7T-Dynamic Residue Amplifier with only 16fF Input Capacitance

Published:2021-11-07 Issue: Volume: Page:
ISSN:
Container-title:2021 IEEE Asian Solid-State Circuits Conference (A-SSCC)
language:
Short-container-title:

Author:

Kim Hyeonsik,Kim Seonkyung,Kim Jintae

Funder

Ministry of Education

Publisher

IEEE

Link

http://xplorestaging.ieee.org/ielx7/9634699/9634177/09634748.pdf?arnumber=9634748

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1. Design of a Linearized Power-Efficient Dynamic Amplifier in 22nm FDSOI;2024 IEEE International Symposium on Circuits and Systems (ISCAS);2024-05-19

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