Design of a Linearized Power-Efficient Dynamic Amplifier in 22nm FDSOI
Author:
Affiliation:
1. University of Toronto,Department of Electrical and Computer Engineering,Toronto,Canada
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx8/10557746/10557828/10558034.pdf?arnumber=10558034
Reference11 articles.
1. A 15.5 dB, wide signal swing, dynamic amplifier using a common-mode voltage detection technique
2. High‐gain and power‐efficient dynamic amplifier for pipelined SAR ADCs
3. A Capacitively Degenerated 100-dB Linear 20–150 MS/s Dynamic Amplifier
4. 23.8 A 41μW 16MS/s 99.2dB-SFDR Capacitively Degenerated Dynamic Amplifier with Nonlinear-Slope-Factor Compensation
5. A 1.5 mW 68 dB SNDR 80 Ms/s 2 $\times$ Interleaved Pipelined SAR ADC in 28 nm CMOS
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