A Generic CDC Modeling for Data Stability Verification
Author:
Affiliation:
1. STMicroelectronics, 12 Rue Jules Horowitz,Grenoble,France,38019
2. Univ. Grenoble Alpes, CNRS, Grenoble INP, TIMA, Institute of Engineering Univ. Grenoble Alpes,Grenoble,France,38000
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10382705/10382711/10382949.pdf?arnumber=10382949
Reference7 articles.
1. A Formal Model of Clock Domain Crossing and Automated Verification of Time-Triggered Hardware
2. MTBF Estimation in Coherent Clock Domains
3. Clock domain crossing (CDC) design & verification techniques using systemverilog;Beer
4. A multiple-clock-domain bus architecture using asynchronous FIFOs as elastic elements;Smith,2003
5. Achieving CDC signoff on multi billion gate designs with hierarchical CDC flow;Chaurasia;Synopsys,2020
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