Design of an 20 GHz Wide-Band Input Buffer
Author:
Affiliation:
1. NOVA University,Lisbon,Portugal
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10382705/10382711/10382798.pdf?arnumber=10382798
Reference8 articles.
1. 27.5 A 4GS/s time-interleaved RF ADC in 65nm CMOS with 4GHz input bandwidth
2. A Low Power, wide-band input buffer for 12bit 1GS/s ADC
3. A 5-GS/s 158.6-mW 9.4-ENOB Passive-Sampling Time-Interleaved Three-Stage Pipelined-SAR ADC With Analog-Digital Corrections in 28-nm CMOS
4. 16.1 A 13b 4GS/s digitally assisted dynamic 3-stage asynchronous pipelined-SAR ADC
5. A 12-b 18-GS/s RF Sampling ADC With an Integrated Wideband Track-and-Hold Amplifier and Background Calibration
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