Design of a Hardware Accelerator Supporting Dual-Mode FIR Filtering Based on the Rocket-Chip Platform
Author:
Affiliation:
1. Technische Universität Dresden,Dresden,Germany
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10420830/10420854/10421244.pdf?arnumber=10421244
Reference10 articles.
1. A Real-Time FPGA-Based Accelerator for ECG Analysis and Diagnosis Using Association-Rule Mining
2. A fully-mapped and energy-efficient FPGA accelerator for dual-function AI-based analysis of ECG
3. Hardware Implementation of an efficient FIR filter for ECG Signal Denoising Application
4. FPGA Implementation of Symmetric Systolic FIR Filter using Multi-channel Technique
5. Low power FIR filter implementation on FPGA using parallel Distributed Arithmetic
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