Fault Resilience Techniques for Flash Memory of DNN Accelerators
Author:
Affiliation:
1. National Taiwan University of Science and Technology,Taipei City,Taiwan,10607
2. National University of Kaohsiung,Kaohsiung City,Taiwan
3. Kyushu Institute of Technology,lizuka,Japan
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/9983856/9983857/09983889.pdf?arnumber=9983889
Reference27 articles.
1. Error-Prediction LDPC and Error-Recovery Schemes for Highly Reliable Solid-State Drives (SSDs)
2. Error Detecting and Error Correcting Codes
3. Reliability-Based ECC System for Adaptive Protection of NAND Flash Memories
4. Characterization of TLC 3D-NAND Flash Endurance through Machine Learning for LDPC Code Rate Optimization
5. On decoding BCH codes
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