Advanced Parasitic Capacitance Extraction using Active Learning
Author:
Affiliation:
1. POSTECH,Dep. of Electrical Engineering,Pohang,Korea
Funder
National Research Foundation
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10395912/10395932/10396354.pdf?arnumber=10396354
Reference7 articles.
1. Effect of interconnect parasitic variations on circuit performance parameters
2. Advanced Field-Solver Techniques for RC Extraction of Integrated Circuits
3. AIDA-PEx: Accurate parasitic extraction for layout-aware analog integrated circuit sizing
4. Layout Capacitance Extraction Using Automatic Pre-Characterization and Machine Learning
5. Connectivity-Based Machine Learning Compact Models for Interconnect Parasitic Capacitances
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