Implementation and Evaluation of On-Chip Network Architectures
Author:
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx5/4380776/4380777/04380859.pdf?arnumber=4380859
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1. A Scalable Methodology for Designing Efficient Interconnection Network of Chiplets;2023 IEEE International Symposium on High-Performance Computer Architecture (HPCA);2023-02
2. Routerless networks-on-chip;Advances in Computers;2022
3. Review, Analysis, and Implementation of Path Selection Strategies for 2D NoCs;IEEE Access;2022
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5. Program diagramming and fundamental programming patterns for a polymorphic computing dataflow processor;Journal of Computer Languages;2021-08
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