Using Multiple Clocks in Highlevel Synthesis to overcome unbalanced clock cycles
Author:
Affiliation:
1. CS. University of Haifa, University of Haifa,Haifa,Israel
2. CS. University of Haifa, University of Haifa,Kafr-Yasif,Israel
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10387741/10387791/10387924.pdf?arnumber=10387924
Reference18 articles.
1. Scheduling algorithms for high-level synthesis;Baruch;ACAM Scientific Journal,1996
2. Path-based scheduling for synthesis
3. LegUp
4. Profiling-Driven Multi-Cycling in FPGA High-Level Synthesis
5. A formal approach to the scheduling problem in high level synthesis
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