A 74.0 dB-SNDR 175.4 dB-FoM Pipelined-SAR ADC Using a Cyclically Charged Floating Inverter Amplifier
Author:
Affiliation:
1. KAIST,Daejeon,South Korea
Funder
National Research Foundation of Korea (NRF)
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10347557/10347908/10347995.pdf?arnumber=10347995
Reference8 articles.
1. 27.4 A 0.4-to-40MS/s 75.7dB-SNDR Fully Dynamic Event-Driven Pipelined ADC with 3-Stage Cascoded Floating Inverter Amplifier
2. A 65-dB-SNDR Pipelined SAR ADC Using PVT-Robust Capacitively Degenerated Dynamic Amplifier
3. A 1 mW 71.5 dB SNDR 50 MS/s 13 bit Fully Differential Ring Amplifier Based SAR-Assisted Pipeline ADC
4. A Two-Step ADC With a Continuous-Time SAR-Based First Stage
5. An Energy-Efficient Comparator With Dynamic Floating Inverter Amplifier
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