56/112Gbps Wireline Transceivers for Next Generation Data Centers on 7nm FINFET CMOS Technology
Author:
Publisher
IEEE
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http://xplorestaging.ieee.org/ielx7/9431363/9431390/09431430.pdf?arnumber=9431430
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1. A 4 $\times$ 112 Gb/s PAM-4 Silicon-Photonic Transmitter and Receiver Chipsets for Linear-Drive Co-Packaged Optics;IEEE Journal of Solid-State Circuits;2024
2. A High Speed and Low BER Dual-mode Adaptive Equalizer Using Hybrid Parallel DFE;IEICE Electronics Express;2024
3. Precursor ISI Cancellation Sliding-Block DFE for High-Speed Wireline Receivers;IEEE Transactions on Circuits and Systems I: Regular Papers;2023-10
4. A 56-Gb/s 50-mW NRZ Receiver in 28-nm CMOS;IEEE Journal of Solid-State Circuits;2022-01
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