Electro-Thermal Mixed-Mode Analysis of HV Complementary DD-SCR’s
Author:
Affiliation:
1. Angstrom Design Automation LLC,CA,USA
2. Analog Devices Corp,San Jose,CA,USA,95134
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10287717/10287664/10287729.pdf?arnumber=10287729
Reference6 articles.
1. IEC ESD Co-Design Methodology for On-Chip Protection at High Voltage Transceivers Vashchenko;kontos;2023 EOS/ESD Symposium,0
2. ESD Design for Analog Circuits
3. The HMM-TLP Miscorrelation at Wafer Level Tests
4. Extreme voltage and current overshoots in HV snapback devices during HBM ESD stress;linten;2008 30th Electrical Overstress/Electrostatic Discharge Symposium,0
5. Angstrom Design Automation;DECIMM User Manual,2022
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