Auto-Tuning of Raw Filters for FPGAs
Author:
Affiliation:
1. Friedrich-Alexander-Universität Erlangen-Nürnberg (FAU),Chair of Hardware/Software Co-Design,Germany
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10035104/10035106/10035117.pdf?arnumber=10035117
Cited by 3 articles. 订阅此论文施引文献 订阅此论文施引文献，注册后可以免费订阅5篇论文的施引文献，订阅后可以查看论文全部施引文献
1. ABACUS: ASIP-Based Avro Schema-Customizable Parser Acceleration on FPGAs;2024 27th International Symposium on Design & Diagnostics of Electronic Circuits & Systems (DDECS);2024-04-03
2. ABACUS: ASIP-based Avro Schema-customizable Parser Acceleration on FPGAs;IEEE INT SYMP DESIGN;2024
3. SPEAR-JSON: Selective Parsing of JSON to Enable Accelerated Stream Processing on FPGAs;2023 33rd International Conference on Field-Programmable Logic and Applications (FPL);2023-09-04
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