Optimized Hardware Architecture of Tile to Raster Scan Buffer for Video Decoder and Display Processor
Author:
Affiliation:
1. Samsung Electronics Co. Ltd.,Hwasung,Korea
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10043349/10043179/10043526.pdf?arnumber=10043526
Reference12 articles.
1. A New Frame Recompression Algorithm Integrated with H.264 Video Compression
2. Reference frame context-adaptive variable-length coder: a real-time hardware-friendly approach for lossless external memory bandwidth reduction in current video-coding systems
3. Memory Bandwidth Requirements of Tile-Based Rendering
4. A VLSI architecture for updating raster-scan displays
5. AVS3 Decoder Architecture and VLSI Implementation for 8K UHDTV Application
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