Design of 40Gb/s PAM4 Signal SerDes Low Power CMOS 64:4 MUX
Author:
Affiliation:
1. Xi’an University of Posts & Telecommunications,Xi’an,China
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10365709/10365561/10365998.pdf?arnumber=10365998
Reference10 articles.
1. 2.3 60Gb/s NRZ and PAM4 transmitters for 400GbE in 65nm CMOS
2. 6.1 A 56Gb/s PAM-4/NRZ transceiver in 40nm CMOS
3. A 112 Gb/s PAM-4 56 Gb/s NRZ Reconfigurable Transmitter With Three-Tap FFE in 10-nm FinFET
4. Design of 56 Gb/s NRZ and PAM4 SerDes Transceivers in CMOS Technologies
5. A 40-Gb/s Full-Rate 2:1 MUX in 0.18-$\mu{\hbox {m}}$ CMOS
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