Low Power-Delay-Product Ternary Adder with Optimized Ternary Cycling Gates
Author:
Affiliation:
1. Shenzhen Institutes of Advanced Technology,Chinese Academy of Sciences,Shenzhen,China
2. CNRS- NTU - THALES Research Alliances, UMI 3288,Singapore
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10365708/10365732/10366016.pdf?arnumber=10366016
Reference18 articles.
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