PV-aware Replacement Policy for Two-level Shared Cache
Author:
Affiliation:
1. IIIT Guwahati,Dept. of CSE,Guwahati,Assam,India,781015
2. IIT Ropar,Dept. of CSE,Ropar,Punjab,India,140001
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10026847/10026888/10027080.pdf?arnumber=10027080
Reference14 articles.
1. Benchmarking modern multiprocessors;bienia;Princeton University,2011
2. The gem5 simulator
3. Optimizing NUCA Organizations and Wiring Alternatives for Large Caches with CACTI 6.0
4. Architecting On-Chip DRAM Cache for Simultaneous Miss Rate and Latency Reduction
5. Working with Process Variation Aware Caches
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