A Modified Low-Offset High Speed Comparator Circuit for Flash Converter Architecture
Author:
Affiliation:
1. Sri Venkateswara College of Engineering,Department of ECE,Tirupati,A.P.,India
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10330805/10331621/10331688.pdf?arnumber=10331688
Reference14 articles.
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2. CMOS Analog Circuit Design;Allen;Oxford University Press,2018
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4. A 30fJ/comparison dynamic bias comparator
5. A Low-Power 8-GS/s Comparator for High-Speed Analog-to-Digital Conversion in $0.13\mu$ m CMOS Technology
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