A Simple Power Analysis of an FPGA implementation of a polynomial multiplier for the NTRU cryptosystem
Author:
Affiliation:
1. CSIC / University of Seville,Instituto de Microelectrónica de Sevilla
Funder
Horizon Europe
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10335898/10335962/10336001.pdf?arnumber=10336001
Reference17 articles.
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5. Practical Side-Channel and Fault Attacks on Lattice-Based Cryptography
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