Dynamic Power Reduction of TCAM Using Selective Precharging of Match Lines
Author:
Affiliation:
1. Sungkyunkwan University,Department of Semiconductor and Display Engineering,Suwon,Republic of Korea
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10020192/10020156/10020668.pdf?arnumber=10020668
Reference7 articles.
1. Local NOR and NAND match-line architecture for high performance;ahn;IEEE Midwest Circuits and Systems Symp,2017
2. A 250-MHz 18-Mb Full Ternary CAM With Low-Voltage Matchline Sensing Scheme in 65-nm CMOS
3. Low-Power Ternary Content-Addressable Memory Design Using a Segmented Match Line
4. A 0.7-fJ/Bit/Search 2.2ns Search Time Hybird-Type TCAM Architecture;choi;IEEE J Solid-State Circuits,2005
5. Low Cost Ternary Content Addressable Memory Using Adaptive Matchline;choi;IEEE International Symposium on Circuits and Systems,2018
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