A 10-bit 1-MS/s Low-Power SAR ADC with an Integrated Buffer in Dual Sample-and-Hold Architecture
Author:
Affiliation:
1. ShanghaiTech University,School of Information Science and Technology,Shanghai,China
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10011216/10011228/10011396.pdf?arnumber=10011396
Reference10 articles.
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4. A 96-channel full data rate direct neural interface in 0.13?m CMOS;walker;2011 Symposium on VLSI Circuits Digest of Technical Papers,2011
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