A 59-fs-rms 35-GHz PLL with FoM of −241-dB in $0.18-\mu \mathrm{m}$ BiCMOS/SiGe Technology

Author:

Bindiganavile Rajath1,Wahid Asif1,Atkinson Jacob1,Tajalli Armin1

Affiliation:

1. University of Utah,LCAS,USA

Funder

DARPA T-MUSIC

Publisher

IEEE

Reference18 articles.

1. Charge-Pump Phase-Lock Loops

2. Matrix phase detector for high bandwidth and low jitter frequency synthesis

3. Monolithic Phase-Locked Loops and Clock Recovery Circuits

4. 17.6 A 21.7-to-26.5GHz charge-sharing locking quadrature PLL with implicit digital frequency-tracking loop achieving 75 fs Jitter and ?250dB FoM;hu;IEEE Int Solid-State Circ Conf (ISSCC),2020

5. A 19-GHz PLL with 20.3-fs Jitter

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