Lint, CDC and RDC analysis for PCIe subsystem using VC_Spyglass
Author:
Affiliation:
1. SIT,(VLSI Design & ES),Dept of E&IE,Tumakuru,572103
2. PPPASSCHIP TECHNOLOGIES PRIVATE LIMITED,Bangalore,560040
3. SIT,Dept of E&IE,Tumakuru,572103
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10440964/10440724/10441323.pdf?arnumber=10441323
Reference11 articles.
1. Testing of Clock-Domain Crossing Faults in Multi-core System-on-Chip
2. Continuous Linting with Automatic Debug
3. Noise Reduction in Reset Domain Crossings Verification Using Formal Verification
4. Study and Analysis of RTL Verification Tool
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