High Performance VLSI Architecture of FIR Filter for Seismic Signal Processing
Author:
Affiliation:
1. Electronics and communication Engineering Vardhaman college of Engineering,Hyderabad,India
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10117587/10117572/10118035.pdf?arnumber=10118035
Reference15 articles.
1. A Low-Power Digit-Based Reconfigurable FIR Filter
2. Design of High-speed, Low-power FIR Filters with Fine-grained Cost Metrics
3. Efficient implementation of digital filters using novel reconfigurable multiplier blocks
4. Design and FPGA implementation of digit-serial FIR filters
5. Hardware-efficient pipelined programmable FIR filter design
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