Optimizing Power Efficiency in SRAM Cells through Memristor-Based Architectures
Author:
Affiliation:
1. Ain Shams University,Faculty of Engineering,Egypt
2. The Knoweldge Hub Universities, Coventry University,Cairo Branch,Egypt
3. TU Wien,Vienna,Austria
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx8/10579967/10579992/10580519.pdf?arnumber=10580519
Reference18 articles.
1. Sensitivity of static noise margins to random doping variations in 6T SRAM cells
2. The Stability Performance Analysis of SRAM Cell Topologies in 90nm and 130nm CMOS technology
3. Memristor-The missing circuit element
4. Hybrid CMOS-memristor 4T-NVSRAM cell for low power applications
5. Statistical Analysis of 5T SRAM Cell for Low Power and Less Area SRAM Based Cache Memory for IoT Applications
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