A 10b 20MS/s SAR ADC with a low-power and area-efficient DAC-compensated reference
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Publisher
IEEE
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http://xplorestaging.ieee.org/ielx7/8061155/8094509/08094568.pdf?arnumber=8094568
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1. A Low-Power SAR ADC with Multi-mode Switching Scheme;2022 10th International Symposium on Next-Generation Electronics (ISNE);2023-05-12
2. A 0.007 mm2 0.6 V 6 MS/s Low-Power Double Rail-to-Rail SAR ADC in 65-nm CMOS;IEEE Transactions on Circuits and Systems II: Express Briefs;2021-09
3. A 10-bit 120-MS/s SAR ADC With Reference Ripple Cancellation Technique;IEEE Journal of Solid-State Circuits;2020-03
4. Modeling of High-Resolution Data Converter: Two-Step Pipelined-SAR ADC based on ISDM;Electronics;2020-01-10
5. A 10-b 20-MS/s SAR ADC With DAC-Compensated Discrete-Time Reference Driver;IEEE Journal of Solid-State Circuits;2019-02
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