28nm FD-SOI technology and design platform for sub-10pJ/cycle and SER-immune 32bits processors
Author:
Publisher
IEEE
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http://xplorestaging.ieee.org/ielx7/7300343/7313811/07313840.pdf?arnumber=7313840
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1. SleepRunner: A 28-nm FDSOI ULP Cortex-M0 MCU With ULL SRAM and UFBR PVT Compensation for 2.6–3.6-μW/DMIPS 40–80-MHz Active Mode and 131-nW/kB Fully Retentive Deep-Sleep Mode;IEEE Journal of Solid-State Circuits;2021-07
2. Adaptive Body Bias Aware Implementation for Ultra-Low-Voltage Designs in 22FDX Technology;IEEE Transactions on Circuits and Systems II: Express Briefs;2020-10
3. A 0.55V 6.3uW/MHz Arm Cortex-M4 MCU with Adaptive Reverse Body Bias and Single Rail SRAM;2020 IEEE Symposium in Low-Power and High-Speed Chips (COOL CHIPS);2020-04
4. Ultra-Low Voltage Microcontrollers;Efficient Design of Variation-Resilient Ultra-Low Energy Digital Processors;2019
5. A 2.7 pJ/cycle 16 MHz, 0.7 $\mu\text{W}$ Deep Sleep Power ARM Cortex-M0+ Core SoC in 28 nm FD-SOI;IEEE Journal of Solid-State Circuits;2018-07
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