Design of an Energy-Efficient SRAM Cell with Optimum Cell Ratio
Author:
Affiliation:
1. NIT Hamirpur HP,India,177005
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10315714/10315787/10315848.pdf?arnumber=10315848
Reference12 articles.
1. A Super-Pipelined Energy Efficient Subthreshold 240 MS/s FFT Core in 65 nm CMOS
2. Design of low power stable SRAM cell
3. A comparative analysis of 6T, 7T, 8T and 9T SRAM cells in 90nm technology
4. Performance Evaluation of 6T, 7T, 8T, and 9T SRAM cell Topologies at 90 nm Technology Node
5. Implementation of Low Power SRAM by Using 8T Decoupled Logic;surendra;Int'l J Eng Research Appl (IJERA),2013
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