Design of a reversible floating-point adder architecture
Author:
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx5/6125891/6144287/06144358.pdf?arnumber=6144358
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2. A Novel, Scalable N*N Reversible Logic Multiplier Design;2022 3rd International Conference on Intelligent Engineering and Management (ICIEM);2022-04-27
3. Quantum Image Scaling Based on Bilinear Interpolation with Decimals Scaling Ratio;International Journal of Theoretical Physics;2021-06
4. Design and implementation of image kernels using reversible logic gates;IET Image Processing;2020-12
5. Quantum LLL with an Application to Mersenne Number Cryptosystems;Progress in Cryptology – LATINCRYPT 2019;2019
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