ABACa: Access Based Allocation on Set Wise Multi-Retention in STT-RAM Last Level Cache
Author:
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/9516456/9516465/09516642.pdf?arnumber=9516642
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1. Multi-Retention STT-MRAM Architectures for IoT: Evaluating the Impact of Retention Levels and Memory Mapping Schemes;IEEE Access;2024
2. Architecting Selective Refresh based Multi-Retention Cache for Heterogeneous System (ARMOUR);2023 60th ACM/IEEE Design Automation Conference (DAC);2023-07-09
3. Efficient placement and migration policies for an STT-RAM based hybrid L1 cache for intermittently powered systems;Design Automation for Embedded Systems;2023-05-05
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