Generation and use of statistical timing macro-models considering slew and load variability

Author:

Sinha Debjit1,Zolotov Vladimir1,Hu Jin1,Raghunathan Sheshashayee K.2,Bhanji Adil1,Casey Christine M.1

Affiliation:

1. IBM T J Watson Research

2. IBM Systems, Bangalore, India

Publisher

ACM

Reference14 articles.

1. Timing abstraction of intellectual property blocks;Venkatesh S. V.;CICC,1997

2. Timing model extraction of hierarchical blocks by graph reduction

3. A hierarchical transistor and gate level statistical timing flow for microprocessor designs;Bhanji A.;TAU,2009

4. On Timing Model Extraction and Hierarchical Statistical Timing Analysis

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