Using unsatisfiable cores to debug multiple design errors

Author:

Suelflow Andre,Fey Goerschwin,Bloem Roderick,Drechsler Rolf

Publisher

ACM Press

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1. Counterexample classification;Software and Systems Modeling;2023-07-26

2. Model Checking Leveraged Error Localization for Complex RTL Designs;2022 IEEE 40th International Conference on Computer Design (ICCD);2022-10

3. Supercharging Plant Configurations Using Z3;Integration of Constraint Programming, Artificial Intelligence, and Operations Research;2021

4. SAT-based Silicon Debug of Electrical Errors under Restricted Observability Enhancement;Journal of Electronic Testing;2019-10

5. Post-Silicon Fault Localization with Satisfiability Solvers;Post-Silicon Validation and Debug;2018-09-02

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