Optimization of DE-QG TFET using novel CIP and DCT techniques
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Publisher
Elsevier BV
Reference39 articles.
1. Challenges and limitations of CMOS scaling for FinFET and beyond architectures;Razavieh;IEEE Trans. Nanotechnol.,2019
2. Opportunities in device scaling for 3-nm node and beyond: FinFET versus GAA-FET versus UFET;Das;IEEE Trans. Electron Devices,2020
3. Ge GAA FETs and TMD FinFETs for the applications beyond Si—A review;Lee;IEEE J. Electron Devices Soc.,2016
4. Investigation of device performance for fin angle optimization in FinFET and gate-all-around FETs for 3 nm-node and beyond;Sahay;IEEE Trans. Electron Devices,2022
5. Tunnel field-effect transistors: State-of-the art;Lu;IEEE Trans. Electron Devices,2014
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1. Ambipolar current suppression in drain elevated TFET using a novel extended drain structure with a moderate doping profile;Microelectronics Journal;2024-09
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