A power-aware 2-dimensional bypassing multiplier using cell-based design flow
Author:
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx5/4534149/4541329/04542173.pdf?arnumber=4542173
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1. Bit-Separable Radix-4 Booth Multiplier for Power-Efficient CNN Accelerator;2024 IEEE Symposium in Low-Power and High-Speed Chips (COOL CHIPS);2024-04-17
2. Area, Delay, and Energy-Efficient Full Dadda Multiplier;Journal of Circuits, Systems and Computers;2023-05-11
3. A Low Power Radix-4 Booth Multiplier With Pre-Encoded Mechanism;IEEE Access;2020
4. Well-Structured Modified Booth Multiplier and Its Application to Reconfigurable MAC Design;IEICE Transactions on Electronics;2011
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