Automatic generation of VHDL hardware code from data flow graphs-Reference-Cited by-同舟云学术

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Automatic generation of VHDL hardware code from data flow graphs

Published:2011-05 Issue: Volume: Page:
ISSN:
Container-title:2011 6th IEEE International Symposium on Applied Computational Intelligence and Informatics (SACI)
language:
Short-container-title:

Author:

Necsulescu Philip I.,Groza Voicu

Publisher

IEEE

Link

http://xplorestaging.ieee.org/ielx5/5783419/5872967/05873059.pdf?arnumber=5873059

Cited by 2 articles. 订阅此论文施引文献订阅此论文施引文献，注册后可以免费订阅5篇论文的施引文献，订阅后可以查看论文全部施引文献

1. GraphRTL: An Agile Design Framework of RTL Code from Data Flow Graphs;2024 2nd International Symposium of Electronics Design Automation (ISEDA);2024-05-10

2. A New HLS Allocation Algorithm for Efficient DSP Utilization in FPGAs;Journal of Signal Processing Systems;2019-05-21

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