A 56 GHz InP VCO for Use in 112 GBaud (112 GBit/s NRZ or 224 GBit/s PAM-4) InP Integrated Optical Receiver Front-End CDR Block
Author:
Affiliation:
1. Carleton University,Department of Electronics (DOE),Ottawa,ON,Canada
Publisher
IEEE
Link
http://xplorestaging.ieee.org/ielx7/10288628/10288648/10288755.pdf?arnumber=10288755
Reference67 articles.
1. A 5–5.47GHz LC-VCO using varactor configuration in 0.18um CMOS technology
2. A 112-Gb/s —8.2-dBm Sensitivity 4-PAM Linear TIA in 16-nm CMOS With Co-Packaged Photodiodes
3. A 77GHz CMOS VCO with 11.3GHz tuning range, 6dBm output power, and competitive phase noise in 65nm bulk CMOS
4. Physical Layer Validation Challenges of Characterizing 100/200 Gbps/Lane Designs;el-chayeb;Keysight Seminar Adavanced Topics in High-Speed Digital Design and Test - Ottawa,2023
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