Research on optimizing circuit topology to improve phase margin

Author:

Huang Keying,Ji Jin,Zhang Yuchen

Publisher

SPIE

Reference12 articles.

1. A low-jitter subsampling phase-locked loop circuit design for array TDC application[D];Ting;Southeast University,2022

2. Topology Derivation of Multiple-Port DC–DC Converters Based on Voltage-Type Ports

3. IEEE Transactions on Power Electronics

4. IEEE Access

5. Research on circuit optimization and Latent circuit of complex power Converter [D];DENG;Guangdong university of technology,2022

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